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표제지 1
Abstract 4
목차 6
수식 차례 14
제1장 서론 16
1.1. 연구 배경 16
1.2. 논문의 구성 19
제2장 나이퀴스트 아날로그/디지털 변환기 20
2.1. 아날로그/디지털 변환기 개요 20
2.2. 나이퀴스트 아날로그/디지털 변환기의 종류 25
2.2.1. 플래시 아날로그/디지털 변환기 25
2.2.2. 축차근사형 아날로그/디지털 변환기 27
2.2.3. 파이프라인 아날로그/디지털 변환기 30
2.2.4. 파이프라인 축차근사형 아날로그/디지털 변환기 34
제3장 파이프라인 축차근사형 아날로그/디지털 변환기의 오류 보정기법 35
3.1. 디지털 오류 보정기법 개요 35
3.2. 플래시 아날로그/디지털 변환기의 중복비트 생성 36
3.3. 축차근사형 아날로그/디지털 변환기의 중복비트 생성 40
제4장 14-비트 50-MS/s 파이프라인 축차근사형 아날로그/디지털 변환기 48
4.1. 설계사양 48
4.2. 기존 아날로그/디지털 변환기 오류 49
4.2.1. 구조 및 동작 49
4.2.2. 잔류전압 생성 오류와 변환기 특성 저하 50
4.3. 제안하는 14-비트 50-MS/s 파이프라인 축차근사형 아날로그/디지털 변환기 구조 53
4.4. 비중첩 클록 생성회로 55
4.5. 중복 1-비트를 포함한 5-비트 축차근사형 아날로그/디지털 변환기 설계 56
4.5.1. 구조 56
4.5.2. 커패시터를 사용한 VCM 기반 디지털/아날로그 변환기[이미지참조] 58
4.5.3. 6-비트 파인 축차근사형 아날로그/디지털 변환기 61
4.5.4. 준 안정성 검출이 가능한 비교기 62
4.5.5. 축차근사형 로직 66
4.5.6. 비교기 클록 생성회로 68
4.5.7. 최상위 코드 검출회로 69
4.5.8. 축차근사형 아날로그/디지털 변환기 시뮬레이션 결과 69
4.6. 잔류전압 생성용 디지털/아날로그 변환기 72
4.6.1. 구조 72
4.6.2. 피드백 시스템의 안정성 73
4.7. 디지털/아날로그 변환기의 사전가산기법 75
4.7.1. 사전가산기법 개요 75
4.7.2. 사전가산기법 원리 및 동작 77
4.8. 잔류전압 증폭기 회로 83
4.8.1. 일반적인 링-증폭기 구조 및 원리 83
4.8.2. 자기 바이어스를 이용한 링-증폭기 87
4.8.3. 링-증폭기 시뮬레이션 결과 92
4.9. 디지털 오류보정 회로 94
4.10. 파이프라인 축차근사형 아날로그/디지털 변환기 전체 시뮬레이션 96
4.11. 요약 103
제5장 결론 104
참고문헌 105
학회활동 110
[그림 1.1] 신호처리 흐름도 16
[그림 1.2] 아날로그/디지털 변환기의 종류 및 특성 17
[그림 1.3] 자율주행 차량의 통신 네트워크 19
[그림 2.1] 아날로그/디지털 변환기의 개념도 20
[그림 2.2] 아날로그/디지털 변환기의 시스템 전달특성 및 양자화 오류 21
[그림 2.3] 아날로그/디지털 변환기의 파워 스펙트럼 및 동적 특성 23
[그림 2.4] 아날로그/디지털 변환기의 정적 특성 24
[그림 2.5] 3-비트 플래시 아날로그/디지털 변환기 (a)블록도 (b)흐름도 26
[그림 2.6] 축차근사형 아날로그/디지털 변환기 (a)블록도 (b)흐름도 28
[그림 2.7] 파이프라인 아날로그/디지털 변환기 (a)블록도 (b)단 내부... 30
[그림 2.8] 파이프라인 아날로그/디지털 변환기 타이밍도 32
[그림 2.9] 파이프라인 아날로그/디지털 변환기 흐름도... 33
[그림 2.10] 파이프라인 축차근사형 아날로그/디지털 변환기 단 내부 블록도 34
[그림 3.1] 오류가 포함된 2-비트 잔류전압 디지털/아날로그 변환기... 35
[그림 3.2] 중복비트가 없는 2-step 아날로그/디지털 변환기... 37
[그림 3.3] 중복비트를 포함한 2-step 아날로그/디지털 변환기 블록도 38
[그림 3.4] 중복비트가 포함된 2-step 아날로그/디지털 변환기 흐름도... 39
[그림 3.5] 2-비트 축차근사형 아날로그/디지털 변환기 블록도 41
[그림 3.6] 2-비트 축차근사형 아날로그/디지털 변환기 전압생성 과정... 42
[그림 3.7] 2-비트 축차근사형 아날로그/디지털 변환기 잔류전압 곡선 43
[그림 3.8] 1.5-비트 축차근사형 아날로그/디지털 변환기 블록도 44
[그림 3.9] 1.5-비트 축차근사형 아날로그 디지털 변환기 전압생성... 46
[그림 3.10] 고정 오프셋이 인가되지 않은 2-비트 축차근사형... 47
[그림 3.11] 고정 오프셋이 인가된 축차근사형 아날로그/디지털 변환기... 47
[그림 4.1] 기존 10-비트 100-MS/s 파이프라인 축차근사형... 49
[그림 4.2] 축차근사형 아날로그/디지털 변환기 잔류전압 생성 오류... 51
[그림 4.3] 제안하는 파이프라인 축차근사형 아날로그/디지털 변환기... 53
[그림 4.4] 비중첩 클록 생성회로 (a)회로도 (b)타이밍도 55
[그림 4.5] 중복 1-비트를 포함한 5-비트 축차근사형 아날로그/디지털... 57
[그림 4.6] 중복 1-비트를 갖는 5-비트 디지털/아날로그 변환기의 전압생성... 60
[그림 4.7] 준 안정성 검출이 가능한 비교기 블록도 62
[그림 4.8] (a)비교기 (b)S-R 레치 (c)valid 생성기 65
[그림 4.9] 축차근사형 로직 (a)회로도 (b)타이밍도 66
[그림 4.10] 비교기 클록 생성회로 68
[그림 4.11] 최상위 코드 검출회로 69
[그림 4.12] 중복 1-비트를 포함한 5-비트 축차근사형 아날로그/디지털... 70
[그림 4.13] 6-비트 축차근사형 아날로그/디지털 변환기 코너별 FFT결과... 71
[그림 4.14] MDAC 구조도 72
[그림 4.15] 사전가산기법 적용 전 타이밍도 (a)클록 듀티비 변경 전... 76
[그림 4.16] 사전가산기법이 적용된 타이밍도 76
[그림 4.17] MDAC 인코더 코드 변환 78
[그림 4.18] 사전가산기법이 적용된 커패시터 스위칭 방식 (a)-15≤'SUM'≤0... 80
[그림 4.19] 사전가산기법이 적용된 디코더 전체 회로도 81
[그림 4.20] 사전가산기법이 적용된 디코더 회로의 기준전압 선택 방법... 82
[그림 4.21] 링 증폭기 회로도 (a)기본 구조 (b)오프셋 인가 84
[그림 4.22] 링-증폭기 주파수응답특성 85
[그림 4.23] 자기 바이어스를 이용한 링-증폭기 회로도 87
[그림 4.24] PVT 변화에 따른 링-증폭기 전류변화 (a)SS (b)TT (c)FF 88
[그림 4.25] 코너, 온도변화에 따른 설계한 링-증폭기 전류·전압 변화 흐름도... 90
[그림 4.26] 링-증폭기 두 번째 단의 출력 바이어스 전압 허용 범위 91
[그림 4.27] 저항 크기에 따른 증폭기 출력 파형 (a)200 Ω (b)400 Ω 92
[그림 4.28] PVT 변화에 따른 설계한 링-증폭기의 개방루프... 93
[그림 4.29] 디지털 오류보정 회로 (a)회로도 (b)타이밍도 94
[그림 4.30] 14-비트 아날로그/디지털 변환기의 오류보정 예시... 95
[그림 4.31] MDAC 사전가산기법 적용 전 파이프라인 축차근사형... 96
[그림 4.32] MDAC 사전가산기법 적용한 파이프라인 축차근사형... 97
[그림 4.33] 설계한 MDAC의 잔류전압 곡선 (a)이상적인경우... 98
[그림 4.34] 14-비트 50-MS/s 파이프라인 축차근사형 아날로그/디지털... 99
[그림 4.35] 14-비트 50-MS/s 파이프라인 축차근사형 아날로그/디지털... 100
[그림 4.36] PVT 변화에 따른 링-증폭기의 개방루프 시뮬레이션 102
본 연구는 감사위원회의 도입과 독립성이 이익조정에 미치는 영향을 분석하고 ESG 경영의 매개효과가 존재하는지 검증하고자 한다. 외환 위기를 비롯한 지속적인 회계 부정 이슈는 기업의 투명경영에 대해 주목하게 하였고, 기업 지배구조의 모니터링 효과를 가지는 감사조직의 역량과 기능에 대한 연구의 필요성이 대두되었다. 특히 2002년 엔론 사건을 계기로 기업에서 감사위원회 도입만으로는 지배구조 개선에 대해 한계가 있는 것으로 나타났고 2018년 삼성바이오로직스 사건에서 3명의 사외이사로 구성된 감사위원회를 가짐에도 불구하고 회계 부정 사건을 방지하지 못했다. 이러한 맥락에서 감사위원회의 도입과 독립성이 회계 투명성에 대해 효과적인 통제 효과를 가지는지를 분석할 필요가 있다. 회계 투명성은 기업에서 제시하는 정보가 투명하게 측정되었는지 판단하는 이론적인 개념이지만 실무에서 이를 측정하기 위해서 주로 경영자의 비윤리적 행위인 이익조정에 주목하게 되는데, 감사위원회의 도입과 독립성이 이익조정에 미치는 영향이 혼재되어 있다.
최근 이해관계자 자본주의와 ESG 경영의 개념이 이슈로 떠오르고 있으며 기업의 존속과 발전은 재무적 성과 뿐만 아니라 비재무적 성과도 중요한 비중을 차지하여야 한다고 주장한다. 이해관계자 자본주의에 따르면 기업의 의사결정은 주주와 경영자만 집중하는 것이 아닌 투자자, 종업원, 공급업체를 포함한 다양한 이해관계자의 이해를 고려하여 의사 결정에 포함하여야 한다고 주장한다. ESG 경영은 지속가능한 경영으로 기업에서 비재무적 정보를 제시하므로 기업의 건전성을 보여주었다. 이러한 환경 속에 이해관계자는 기업에서 제시하는 정보의 투명성에 대해 높은 관심을 가지며, 기업은 투명경영을 수행하고 있음을 보여주기 위해 ESG 경영성과에 관심을 가지게 된다. 기업은 또한 투명경영을 수행하기 위해 감사위원회 조직을 도입하고 ESG 경영을 수행하며 회계정보의 투명성을 높이고자 한다. 선행연구에 따르면 감사위원회를 도입한 기업은 ESG 경영과 유의한 양(+)의 관련성을 가지며, ESG 경영에 따른 ESG 정보공시는 이해관계자로부터 기업이 투명경영을 수행하고 있음을 보여줌으로써 정보에 대한 신뢰성이 증가하는 것으로 나타났다. 이에 ESG 경영은 감사위원회 도입과 독립성이 이익조정에 미치는 영향에서 매개효과를 가질 것으로 예상할 수 있으나 이를 실증분석을 통해 증명하는 연구가 아직 없으므로 본 연구는 감사위원회의 도입과 독립성이 이익조정에 미치는 영향에서 ESG 경영의 매개효과를 분석하였다.
연구 결과, 첫째, 감사위원회의 도입과 독립성은 재량적 이익조정과 실물 이익조정 모두 음(-)의 관련성이 있는 것으로 나타났다. 둘째, 감사위원회의 도입과 독립성이 ESG 경영에 미치는 영향은 아주 유의한 긍정적인 효과를 가지고 있다. 셋째, ESG 경영이 재량적 이익조정과 실물 이익조정에 모두 음(-)의 관계가 나타났다. 넷째, ESG 경영이, 감사위원회의 도입과 독립성이 이익조정 행위에 미치는 영향을 분석한 결과, ESG 경영은 실물 이익조정에 유의한 음(-)의 매개효과를 보였지만, 재량적 발생액에 유의한 매개효과를 관찰하지 못했다.
감사위원회의 도입과 독립성이 이익조정에 미치는 영향에서 ESG 경영의 조절효과를 배제할 수 없으므로 추가분석에서 ESG 경영의 조절효과를 분석하였다. 연구 결과 감사위원회 도입한 기업에 ESG 경영을 수행하면 실물 이익조정을 억제하는 효과를 보였지만 재량적 발생액과 통계적으로 유의한 결과를 보여주지 못했다. 또한 감사위원회의 독립성이 높은 기업에서 ESG 활동을 수행하면 실제 이익조정을 억제하는 효과를 가지는 것으로 확인하였다. ESG 경영의 하위 변수(환경, 사회, 지배구조)로 측정한 결과 유사한 결과를 보였다.
본 연구는 감사위원회 도입과 독립성이 이익조정에 미치는 영향에서 ESG 경영의 매개효과를 검증하였다. 감사위원회의 도입과 독립성이 재무성과 투명성을 제고하고 비재무적 성과인 ESG 경영에 영향을 미치고 이는 이익조정 행위를 감소시키는 것을 시사한다. 하지만 본 연구는 공시된 정보를 사용하므로 기업이 실질적으로 투명경영을 하였지만 정보 공시를 하지 않으면 연구 대상에서 벗어남으로 연구결과와 현실이 다를 수 있는 한계점이 존재한다. 또한 선행연구에 따라 감사위원회의 독립성을 전원 사외이사 여부의 더미 변수로 측정하였지만 실제 기업환경에서 감사위원회가 독립성을 가지고 운영하였는지를 판단하는 근거가 부족하다. 마지막으로 통제변수가 선행연구마다 다르게 측정됨으로 본 연구에서 사용되는 통제변수가 다른 연구로 적용될 경우 측정치가 다르게 나타날 수 있는 한계점이 존재한다.*표시는 필수 입력사항입니다.
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