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시뮬레이션을 이용한 웨이퍼 FAB 공정에서의 병목 공정 탐지 프레임워크 / 박상철 ; 양가람 ; 정용호 ; 김대환 1

ABSTRACT 1

1. 서론 1

2. 연구 배경 및 필요성 2

3. 연구 내용 3

3.1. Pegging과 Simulation 3

3.2. 병목 공정 탐지 프레임워크 4

3.3. 실험 모델 5

4. 실험 결과 6

4.1. Case 1 6

4.2. Case 2 8

5. 결론 8

References 9

[저자소개] 10

권호기사

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기사명 저자명 페이지 원문 목차
BIM 라이브러리 제작을 위한 3차원 MCAD 데이터의 재사용에 관한 연구 : 기계 설비 분야 BIM 라이브러리 중심으로 김재정, 최동권 pp.263-271

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BIM 정보프레임워크 기반의 토목구조물 정보모델링 표준화방안 조찬원, 남정용 pp.281-293

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개방형BIM기반의 건축법규검토를 위한 법규유형화 및 적용방안 최중식, 김인한, 김용하 pp.224-235

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근사 최적화를 활용한 뻐꾸기 탐색법의 성능 개선 이세정 pp.245-252

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대규모 점군 및 폴리곤 모델의 GLSL 기반 실시간 렌더링 알고리즘 박상근 pp.294-304

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스마트폰 증강현실 내비게이션의 인지능력과 호응도에 관한 연구 이재열, 손민국, 이승태 pp.272-280

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시뮬레이션을 이용한 웨이퍼 FAB 공정에서의 병목 공정 탐지 프레임워크 박상철, 양가람, 정용호, 김대환 pp.214-223

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시스템 LSI 반도체 FAB의 납기만족을 위한 예약 기반의 디스패칭 룰 박상철, 서정철, 정용호 pp.236-244

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전 방향 이미지와 디지털 맵을 활용한 3차원 실사 도시모델 생성 기법 연구 한순흥, 김형기, 강윤아 pp.253-262

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해양플랜트 LNG FPSO 압축기의 신뢰성 및 회귀분석 기반 고장시점 추정 방법 전홍배, 조상제, 신종호, 최상덕 pp.203-213

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참고문헌 (15건) : 자료제공( 네이버학술정보 )

참고문헌 목록에 대한 테이블로 번호, 참고문헌, 국회도서관 소장유무로 구성되어 있습니다.
번호 참고문헌 국회도서관 소장유무
1 Park, S., Yim, H. and Jee, H., 2009, Digital Fabtory for Virtual Line Simulation and RFID, Proceedings of the Society of CAD/CAM Engineers Conference, pp.489-492. 미소장
2 Implementation of an E-BOM Copy Method for an Order-specific Semiconductor Equipment 소장
3 Park, G.M., 2008, Performance Evaluation of Scheduling Rules using Manufacturing Line Simulation, Konkuk University. 미소장
4 Gurnani, H., Anupindi, R. and Akella, R., 1992, Control of Batch Processing Systems in Semiconductor Wafer Fabrication Facilities, IEEE Transactions on Semiconductor Manufacturing (v5, 1992), pp.319-328. 미소장
5 A survey of dispatching rules for operational control in wafer fabrication 네이버 미소장
6 Zhou, Z. and Rose, O., 2010, A Pull/Push Concept for Tool Group Workload Balance in a Wafer Fab, In Proceedings of the 2010 Winter Simulation Conference, pp.2516-2512. 미소장
7 Rosenberg, O. and Ziegler, H., 1992, A Comparison of Heuristic Algorithms for Cost-oriented Assembly Line Balancing, Zeitschrift für Operations Research 36, pp.477-495. 미소장
8 Zhou, Z. and Rose, O., 2009, A Bottleneck Detection and Dynamic Dispatching Strategy for Semiconductor Wafer Fabrication Facilities, Proc. of the Winter Simulation Conference, December 13-16, Austin, TX, USA, pp.1646-1656. 미소장
9 IEEE Transactions on Semiconductor Manufacturing information for authors 네이버 미소장
10 Fowler, J. and Robinson, J., 1995, Measurement and Improvement of Manufacturing Capacities (MIMAC): Final Report, Technical Report 95062861A-TR, SEMATECH, Austin, TX. 미소장
11 Zhou, Z. and Rose, O., 2012, WIP Control and Calibration in a Wafer FAB, In Proceedings of the 2012 Winter Simulation Conference, Research46, pp.5515-5529. 미소장
12 Kim, S., Yea, S. and Kim, B., 2000, Stepper Scheduling in Semiconductor Wafer Fabrication Process, The Proceedings of International Conference on Modeling and Analysis of Semiconductor Manufacturing, Arizona, pp.157-167. 미소장
13 Lee, B., Lee, Y.H., Yang, T. and Ignisio, J., 2008, A Due-date Based Production Control Policy using WIP Balance for Implementation in Semiconductor Fabrications, International Journal of Production. 미소장
14 Tanjong, Shirley J., 2011, Bottleneck Management Strategies in Semiconductor Wafer Fabrication Facilities, Proceedings of the 2011 Inter- national Conference on Industrial Engineering and Operations Management Kuala Lumpur, Malaysia, January 22-24. 미소장
15 Scheduling semiconductor wafer fabrication 네이버 미소장

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